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// NOT LIMITED TO, THE IMPLIED WARRANTIES OF MERCHANTABILITY AND FITNESS FOR A PARTICULAR PURPOSE.
 
$END
 
//VME Connector parts
 
//J1/P1 CONNECTOR
 
$PART_NAME VMEP1
$REF_PREFIX P
$JEDEC_TYPE DIN5X32
$PIN_COUNT 160
$PORTS
  GND[26]      Z2 Z4 Z6 Z8 Z10 Z12 Z14 Z16 Z18 Z20 Z22 Z24 Z26 Z28 Z30 Z32
               A9 A11 A15 A17 A19 B20 B23 C9 D2 D31;
  VCC[10]      D12 D14 D16 D18 D20 D22 D24 D26 D28 D30;
  V1           D3;  //+48V Supply
  V1N          D6;  //-48V Supply
  V2           D4;  
  V2N          D7;
  VCC5[3]      A32 B32 C32;  //+5V Supply
  VCC12        C31;  //+12V Supply
  VCC12N       A31;  //-12V Supply
  VCC5STDBY    B31;  //+5V StandBy
  VPC[2]       D1 D32;  //Pre-charges
  RESERVED[14] Z13 Z15 Z17 Z19 Z21 Z23 Z25 Z27 Z29 Z31 D19 D21 D23 D25;
  RESERVEDU[2] D5 D8;
  MPR          Z1;
  MCLK         Z3;
  MSD          Z5;
  MMD          Z7;
  MCTL         Z9;
  RESP_N       Z11;
  D[15:0]      C8 C7 C6 C5 C4 C3 C2 C1 A8 A7 A6 A5 A4 A3 A2 A1;
  SYSCLK       A10;
  DS1_N        A12;
  DS0_N        A13;
  WRITE_N      A14;
  DTACK_N      A16;
  AS_N         A18;
  IACK_N       A20;
  IACKIN_N     A21;
  IACKOUT_N    A22;
  AM[5:0]      C14 A23 B19 B18 B17 B16;
  A[23:1]      C15 C16 C17 C18 C19 C20 C21 C22 C23 C24 C25 C26 C27 C28 C29 C30
               A24 A25 A26 A27 A28 A29 A30;
  BBSY_N       B1;
  BCLR_N       B2;
  ACFAIL_N     B3;
  BG0IN_N      B4;
  BG0OUT_N     B5;
  BG1IN_N      B6;
  BG1OUT_N     B7;
  BG2IN_N      B8;
  BG2OUT_N     B9;
  BG3IN_N      B10;
  BG3OUT_N     B11;
  BR_N[3:0]    B15 B14 B13 B12;
  SERA         B21;
  SERB         B22;
  IRQ[7:1]     B24 B25 B26 B27 B28 B29 B30;
  SYSFAIL_N    C10;
  BERR_N       C11;
  SYSRESET_N   C12;
  LWORD_N      C13;
  GAP_N        D9;
  GA[4:0]      D17 D15 D13 D11 D10;
  LI_I_N       D27;
  LI_O_N       D29;
$ENDPORTS
$ENDPART
 
//J2/P2 CONNECTOR
 
$PART_NAME VMEP2
$REF_PREFIX P
$PIN_COUNT 160
$JEDEC_TYPE DIN5X32
$PORTS
  GND[21]      Z2 Z4 Z6 Z8 Z10 Z12 Z14 Z16 Z18 Z20 Z22 Z24 Z26 Z28 Z30 Z32
               D31 B2 B12 B22 B31;
  VCC5[3]      B1 B13 B32;
  UD_Z[16:1]   Z31 Z29 Z27 Z25 Z23 Z21 Z19 Z17 Z15 Z13 Z11 Z9 Z7 Z5 Z3 Z1;
  UD_D[30:1]   D30 D29 D28 D27 D26 D25 D24 D23 D22 D21 D20 D19 D18 D17 D16
               D15 D14 D13 D12 D11 D10 D9 D8 D7 D6 D5 D4 D3 D2 D1;
  UD_A[32:1]   A32 A31 A30 A29 A28 A27 A26 A25 A24 A23 A22 A21 A20 A19 A18 A17 A16
               A15 A14 A13 A12 A11 A10 A9 A8 A7 A6 A5 A4 A3 A2 A1;
  UD_C[32:1]   C32 C31 C30 C29 C28 C27 C26 C25 C24 C23 C22 C21 C20 C19 C18 C17 C16
               C15 C14 C13 C12 C11 C10 C9 C8 C7 C6 C5 C4 C3 C2 C1;
  RETRY_N      B3;
  A[31:24]     B11 B10 B9 B8 B7 B6 B5 B4;
  D[31:16]     B30 B29 B28 B27 B26 B25 B24 B23 B21 B20 B19 B18 B17 B16 B15 B14;
  VPC          D32;
$ENDPORTS
$ENDPART                                                            
 
  
  
  
  

 

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